Index of /archive/邏設實驗/107馬席彬/Lab_zip/lab11_3_107061212_ver1.zip (Unzipped Files)/

../
blk_mem_gen_0/                                     21-Mar-2026 11:06       -
blk_mem_gen_1/                                     21-Mar-2026 11:06       -
blk_mem_gen_2/                                     21-Mar-2026 11:06       -
blk_mem_gen_3/                                     21-Mar-2026 11:06       -
blk_mem_gen_4/                                     21-Mar-2026 11:06       -
blk_mem_gen_5/                                     21-Mar-2026 11:06       -
blk_mem_gen_6/                                     21-Mar-2026 11:06       -
1.JPG                                              21-Mar-2026 11:06    9956
2.JPG                                              21-Mar-2026 11:06     10K
3.JPG                                              21-Mar-2026 11:06     10K
4.JPG                                              21-Mar-2026 11:06    9678
5.JPG                                              21-Mar-2026 11:06     10K
6.JPG                                              21-Mar-2026 11:06     11K
7.JPG                                              21-Mar-2026 11:06     10K
clock_divisor.v                                    21-Mar-2026 11:06     270
clock_generator.v                                  21-Mar-2026 11:06    2621
lab11_3.xdc                                        21-Mar-2026 11:06    1758
mem_addr_gen.v                                     21-Mar-2026 11:06     687
random.v                                           21-Mar-2026 11:06    1282
topmodule.bit                                      21-Mar-2026 11:06      2M
topmodule.v                                        21-Mar-2026 11:06    5071
vga_controller.v                                   21-Mar-2026 11:06    2174